A
Ansunamu
Guest
Cosa
c'è di diverso tra Verilog-A e Verilog-AMS?Quale è meglio?
c'è di diverso tra Verilog-A e Verilog-AMS?Quale è meglio?
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N
news
Guest
Dobrze poinformowane żródła rzuciły nieco światła na specyfikację i daty rozpoczęcia sprzedaży przyszłego flagowego smartfona BlackBerry, o nazwie kodowej ''Venice''. Pojawi się on w listopadzie 2015 r. i będzie pierwszym smartfonem kanadyjskiego producenta z Androidem. Według tych samych żródeł smartfon BlackBerry "Venice" będzie działać pod kontr...
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F
flyinspace
Guest
Penso Verilog-A è il verilog linguaggio che può descrivere il circuito analogico.Tuttavia, V-AMS può descrivere il segnale mixato circuito.Così V-AMS cosa può fare di più rispetto VA.
B
borodenkov
Guest
Verilog-A è solo analogico spec.Verilog-AMS consente sia analogiche che digitali.Esso comprende Verilog-A come sottinsieme.
Guardate qui per i dettagli:
http://www.eda.org/verilog-ams/htmlpages/overview.html
Guardate qui per i dettagli:
http://www.eda.org/verilog-ams/htmlpages/overview.html
A
Ansunamu
Guest
Ok,
vedo
Quale strumento EDA venditore fornire il miglior strumento per Verilog-A o Verilog-AMS?
vedo
Quale strumento EDA venditore fornire il miglior strumento per Verilog-A o Verilog-AMS?
T
tlihu
Guest
Ansunamu ha scritto:
Ok, vedoQuale strumento EDA venditore fornire il miglior strumento per Verilog-A o Verilog-AMS?
Ok, vedoQuale strumento EDA venditore fornire il miglior strumento per Verilog-A o Verilog-AMS?
N
niko_zhang
Guest
verifica
Siamo spiacenti, ma è necessario il login per visualizzare questo attaccamento
Siamo spiacenti, ma è necessario il login per visualizzare questo attaccamento
H
hgby2209
Guest
Quale simulatore può sostenere verilog-uno e verilog-emendamenti?
Z
Zhan
Guest
Cadence LDV 5,1 può OSTEGNO AMS
H
hgby2209
Guest
LDV 5,1 può OSTEGNO AMS, LDV 5,0 può o non può?
Modelsim può o non può?
Modelsim può o non può?
F
flyinspace
Guest
Penso che anche in grado di supportare LDV5.0 AMS.
Tuttavia, non può Modelsim.
Tuttavia, non può Modelsim.
P
pci1000
Guest
LdV è solo un simlator o è tutta la serie di flusso?
U
uncle_urfi
Guest
Strumenti devono essere titolari di una licenza rilasciata separatamente.
per esempio, l'installazione presso il nostro abbiamo la licenza per verilog-bis, Verilog e VHDL-AMS, ma non VHDL-AMS.Ci sono in esecuzione LDV5.0.
Gli strumenti che integra tutti è la Cadence AMS designer.Per ulteriori informationl, vai cadence.com e registrarsi per il vero dimostrazioni video (circa l'8 di essi, un totale di 10 ore) vi terrà impegnati durante il fine settimana.
Spectre IC5 supporta anche verilog-emendamenti e verilog-uno, altri non l'ho provato, ma sono certo che lei può Strumenti licenza separatamente.L'ovvia limitazione viene quando si ha bisogno per passare tra dire "comportamentali" e "schema" o "estratto" punto di vista.Per cambiare punto di vista in modo efficiente, è bello avere la AMS Designer.
Happy esplorare.
---
Per rispondere alla domanda iniziale.verilog-uno aveva discipline.Ad esempio "elettrici", "termale",
ecc Due reti con diverse discipline non poteva essere collegato senza una vera e propria interfaccia di blocco.Verilog-AMS ha estensioni segnale misto e ora comprende discipline come la "logica" che definiscono le aree della tua digitale circuito.Quindi è un superset di verilog-uno.
per esempio, l'installazione presso il nostro abbiamo la licenza per verilog-bis, Verilog e VHDL-AMS, ma non VHDL-AMS.Ci sono in esecuzione LDV5.0.
Gli strumenti che integra tutti è la Cadence AMS designer.Per ulteriori informationl, vai cadence.com e registrarsi per il vero dimostrazioni video (circa l'8 di essi, un totale di 10 ore) vi terrà impegnati durante il fine settimana.
Spectre IC5 supporta anche verilog-emendamenti e verilog-uno, altri non l'ho provato, ma sono certo che lei può Strumenti licenza separatamente.L'ovvia limitazione viene quando si ha bisogno per passare tra dire "comportamentali" e "schema" o "estratto" punto di vista.Per cambiare punto di vista in modo efficiente, è bello avere la AMS Designer.
Happy esplorare.
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Per rispondere alla domanda iniziale.verilog-uno aveva discipline.Ad esempio "elettrici", "termale",
ecc Due reti con diverse discipline non poteva essere collegato senza una vera e propria interfaccia di blocco.Verilog-AMS ha estensioni segnale misto e ora comprende discipline come la "logica" che definiscono le aree della tua digitale circuito.Quindi è un superset di verilog-uno.
M
mrhfw
Guest
pls post il livello di piena verilgo-AMS
grazie
Richard
grazie
Richard
U
uncle_urfi
Guest
Il testo integrale dei documenti che sono in megabyte, è possibile scaricare dal sito web IEEE Xplore.(riferimenti qui di seguito)
------------------------------------------
Verilog AMS manuale può essere scaricato da qui:
http://www.eda.org/verilog-ams/htmlpages/public-docs/lrm/2.1/AMS-LRM-2-1.pdf
-------------------------------------------------- ---------------
IEEE Std 1364-2001
Anno: 2001
Standard IEEE Verilog linguaggio di descrizione hardware
Page (s): 0_1-856
[Abstract] [PDF Full-Text (3773 KB)]
-------------------------------------------------- ---------------
IEEE Std 1.076,1-1.999
Anno: 1999
Standard IEEE VHDL analogico a segnale misto e le estensioni
Page (s):
[Abstract] [Full-Text PDF (928 KB)]-------------------------------------------------- ------------------------------
IEEE Std 1076-2002 (Revisione degli standard IEEE 1076, 2002 edn)
Anno: 2002
Standard IEEE 1076 VHDL Language Reference Manual
Page (s): 0_1-300
[Abstract] [PDF Full-Text (1910 KB)]
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Verilog AMS manuale può essere scaricato da qui:
http://www.eda.org/verilog-ams/htmlpages/public-docs/lrm/2.1/AMS-LRM-2-1.pdf
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IEEE Std 1364-2001
Anno: 2001
Standard IEEE Verilog linguaggio di descrizione hardware
Page (s): 0_1-856
[Abstract] [PDF Full-Text (3773 KB)]
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IEEE Std 1.076,1-1.999
Anno: 1999
Standard IEEE VHDL analogico a segnale misto e le estensioni
Page (s):
[Abstract] [Full-Text PDF (928 KB)]-------------------------------------------------- ------------------------------
IEEE Std 1076-2002 (Revisione degli standard IEEE 1076, 2002 edn)
Anno: 2002
Standard IEEE 1076 VHDL Language Reference Manual
Page (s): 0_1-300
[Abstract] [PDF Full-Text (1910 KB)]
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D
duncan94022
Guest
uncle_urfi,
"Strumenti devono essere titolari di una licenza rilasciata separatamente.
per esempio, l'installazione presso il nostro abbiamo la licenza per verilog-bis, Verilog e VHDL-AMS, ma non VHDL-AMS. "
verilog-uno è inserito in entrambi spettro ams e designer.ams designer comprende verilog-a,-verilog emendamenti, e VHDL-AMS.È possibile ottenere tutti i loro emendamenti con designer e non sono titolari di una licenza rilasciata separatamente.Qualcosa è messo con il tuo installaton se avete verilog-emendamenti e non VHDL-AMS.Almeno questo è vero per IC 5.0.x.
"Strumenti devono essere titolari di una licenza rilasciata separatamente.
per esempio, l'installazione presso il nostro abbiamo la licenza per verilog-bis, Verilog e VHDL-AMS, ma non VHDL-AMS. "
verilog-uno è inserito in entrambi spettro ams e designer.ams designer comprende verilog-a,-verilog emendamenti, e VHDL-AMS.È possibile ottenere tutti i loro emendamenti con designer e non sono titolari di una licenza rilasciata separatamente.Qualcosa è messo con il tuo installaton se avete verilog-emendamenti e non VHDL-AMS.Almeno questo è vero per IC 5.0.x.
L
labodhibo
Guest
uncle_urfi,
Spectre non supporta verilogAMS, che supporta solo verilogA e
ahdl (spectreHdl).
Spectre non supporta verilogAMS, che supporta solo verilogA e
ahdl (spectreHdl).
L
labodhibo
Guest
Ed è proprio su Duncan amsDesigner.
Sostiene tutte le lingue, tra cui a livello comportamentale.
In vhdlAMS, vi sono alcune limitazioni quando si utilizza con
verilogAMS.
Labo
Sostiene tutte le lingue, tra cui a livello comportamentale.
In vhdlAMS, vi sono alcune limitazioni quando si utilizza con
verilogAMS.
Labo
T
triwolf
Guest
LRM già versione 2.2
S
ship_baba
Guest
come simulare nel modello sim o in aldec
H
Hunter_BJUT
Guest
quasi la stessa