M
moisiad
Guest
Ciao di nuovo
Ho completato la progettazione di due fasi, piegato cascode OPAMP con le seguenti specifiche:
VDD = 1V, Guadagno = 67db, UGB = 300MHz, F3db = 100K
Le specifiche OPAMP opererà in un ADC con N = 8bits e Fclk = 60MHz
La mia domanda è la seguente:
Secondo Baker Book "CMOS, Misto - Signal Circuit Design", pp.339
in modo che il tempo di essere inferiore a 1/Fckl, l'UGB, è definito dalla equazione UGB> 0,22 * (N 1) * Fckl.Quindi, nel mio caso l'UGB = 300MHz soddisfa questa necessità.
Tuttavia per quanto riguarda la F3db.C'è qualche relazione al momento della liquidazione OPAMP.Perché ho eseguito alcune simulazioni in prima analisi transienti e la OPAMP sembra avere molto tempo accanto a grandi setlling che l'equazione di cui sopra è valida per il mio caso.
Ho completato la progettazione di due fasi, piegato cascode OPAMP con le seguenti specifiche:
VDD = 1V, Guadagno = 67db, UGB = 300MHz, F3db = 100K
Le specifiche OPAMP opererà in un ADC con N = 8bits e Fclk = 60MHz
La mia domanda è la seguente:
Secondo Baker Book "CMOS, Misto - Signal Circuit Design", pp.339
in modo che il tempo di essere inferiore a 1/Fckl, l'UGB, è definito dalla equazione UGB> 0,22 * (N 1) * Fckl.Quindi, nel mio caso l'UGB = 300MHz soddisfa questa necessità.
Tuttavia per quanto riguarda la F3db.C'è qualche relazione al momento della liquidazione OPAMP.Perché ho eseguito alcune simulazioni in prima analisi transienti e la OPAMP sembra avere molto tempo accanto a grandi setlling che l'equazione di cui sopra è valida per il mio caso.