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FoxB
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Hi All!
IP PCI CORE v5.1.9
Stato: disponibile -
il mantenimento di rilascio
Caratteristiche:
- Correzione di vari problemi trovati in v5.1.8
(vedi Storia documento Revisione completa per i dettagli-http: / / www.plda.com / pcicore / pci_core_history.pdf / 17KB)- Correzioni possibile interrompere l'attività in altri Stati membri il potere di gestione di D0.
- Correzioni appiccicoso ripristinare la funzionalità (PME evento da D3cold) come asincroni (PCI o reimpostare PowerOn Reset) e sincrona di reset è ora solo il potere di gestione di reset
- Correzione di parità di calcolo utilizzando "cbe_out" segnale invece di "cbe_in" segnale di master transazione.
- Correzioni possibile perdita di dati che possono verificarsi durante il 64-bit DMA scrivere sui primi dati quando il DMA riavviare / continuerà il suo trasferimento, dopo un evento di latenza timer (bug introdotto solo nella versione 5.1.8).
- Correzioni di terminazione master problemi di latenza, quando scade il timer per il basso valore di latenza timer registro quando viene rimosso prima di concedere i dati prima fase.
- Correzione dei problemi di confine con BAR obiettivo senza scollegare i dati esterni quando capitano tenta di attraversare il confine BAR.
- Correzioni PERR # uscita consentire problemi.
- Correzione di segnalazione degli errori sulla SR15 # Serr errore anche se la segnalazione degli errori di sistema è disattivato.
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Stato: disponibile -
il mantenimento di rilascio
Caratteristiche:
- Correzione di vari problemi trovati in v5.1.8
(vedi Storia documento Revisione completa per i dettagli-http: / / www.plda.com / pcicore / pci_core_history.pdf / 17KB)- Correzioni possibile interrompere l'attività in altri Stati membri il potere di gestione di D0.
- Correzioni appiccicoso ripristinare la funzionalità (PME evento da D3cold) come asincroni (PCI o reimpostare PowerOn Reset) e sincrona di reset è ora solo il potere di gestione di reset
- Correzione di parità di calcolo utilizzando "cbe_out" segnale invece di "cbe_in" segnale di master transazione.
- Correzioni possibile perdita di dati che possono verificarsi durante il 64-bit DMA scrivere sui primi dati quando il DMA riavviare / continuerà il suo trasferimento, dopo un evento di latenza timer (bug introdotto solo nella versione 5.1.8).
- Correzioni di terminazione master problemi di latenza, quando scade il timer per il basso valore di latenza timer registro quando viene rimosso prima di concedere i dati prima fase.
- Correzione dei problemi di confine con BAR obiettivo senza scollegare i dati esterni quando capitano tenta di attraversare il confine BAR.
- Correzioni PERR # uscita consentire problemi.
- Correzione di segnalazione degli errori sulla SR15 # Serr errore anche se la segnalazione degli errori di sistema è disattivato.
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