in ASIC, per quanto tempo deve reimpostare segnale di tenere attivi?

U

UIL

Guest
Voglio aggiungere una funzione nel chip per reimpostare il modulo dal software
ma, non so per quanto tempo il segnale di reset dovrebbe tenere
in un esempio, questa volta è di 3 cicli e mezzo, ma, qual è il principio su di esso?
grazie mille!

 
Dipende da come il tuo chip è stato progettato.Se avete solo flip-flop e l'uso di reset asincrono
per ciascuna di esse, è necessario un solo periodo di clock.Devi tenere a mente, che il reset non deve andare vicino al bordo inattivi attiva di un orologio.Bisogna garantire che tutti i tuoi chip
(ad eccezione della memoria

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) Viene inizializzato correttamente, in modo da guardare il circuito, se ha bisogno di più di un periodo di clock.Si tratta di una buona pratica di estendere l'impulso di reset sul numero definito di cicli di clock ..

 
Ho incontrato un caso che l'uso di tre cicli di clock e un mezzo per il soft reset.Non so il motivo, perché penso che un orologio è sufficiente per la funzione di ripristino.Perchè vi sono nel processo di back-end?

 
salve,
un ciclo non è sufficiente becoz tuo clock, magari catturare una glitch e causare tutti i reset design.
stato così normalmente reset è dura abbastanza, e 3, orologio e mezzo è anche breve, nel mio disegno, che durano più di 10 o più cicli di stabilire il reale stato di reset.

 
ma se il sigan reset durare troppo a lungo, l'ingegnere del software non conosce il instrunctions prossimi non saranno validi, e perdere l'operazione.Come faccio a scambi di essa?

 
UIL ha scritto:

ma se il sigan reset durare troppo a lungo, l'ingegnere del software non conosce il instrunctions prossimi non saranno validi, e perdere l'operazione.
Come faccio a scambi di essa?
 
UIL ha scritto:

Voglio aggiungere una funzione nel chip per reimpostare il modulo dal software

ma, non so per quanto tempo il segnale di reset dovrebbe tenere

in un esempio, questa volta è di 3 cicli e mezzo, ma, qual è il principio su di esso?

grazie mille!
 

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