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edaguy69

Guest
Does it mix di sostegno simulazione di livello ancora.Come si confronta con Hsim?
Grazie

 
Per la mia esperienza, starším supporta solo la simulazione a livello di transistor.Non si può fare di spezie miste e simulazione Verilog.Tuttavia, è possibile tradurre la netlist Verilog livello cancello transisor livello da parte di alcuni strumenti.

 
kwkam ha scritto:

Per la mia esperienza, starším supporta solo la simulazione a livello di transistor.
Non si può fare di spezie miste e simulazione Verilog.
Tuttavia, è possibile tradurre la netlist Verilog livello cancello transisor livello da parte di alcuni strumenti.
 
Non so la versione corrente di starším.Nel caso di HSIM 2.0, ha richiesto di tradurre la netlist Verilog di spezie prima di fare la simulazione.Possono essere altri strumenti farlo automaticly.Credo che per la simulazione accurata, Verilog netlist deve tradurre al modello di spezie.

 
edaguy69 ha scritto:

Questa è una vecchia storia.
Due anni fa, hanno annunciato che sosterranno mix di simulazione di livello con qualche Verilog comune.
È per questo che chiedo.
La maggior parte degli strumenti di simulazione che hanno funzione di: Hsim.
Nanosim, MachTA ...
 
Smash il kernel è solo singolo "mista", con una descrizione non nativi digitali?

 

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